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AMDは、Ryzen 9000「Zen 5」デスクトップCPUのコア間レイテンシを改善する新しいBIOSパッチの開発に取り組んでいると報じられている。

AMDのRyzen 9000 「Zen 5 」CPUは、レッドチームがコア間レイテンシを改善するBIOSパッチの展開を計画していることから、さらなる改善が見られるだろう。

AMDの「Zen 5」ベースのRyzen 9000デスクトップCPUは、我々が期待したほどの性能向上をもたらさなかった。

その理由の1つは、Windows 11の最適化が不十分だったことに起因しているが、それだけではない。最適化されていないCore Parkingは、未完成のソフトウェアとBIOSサポートが原因と思われるが、理想的なパフォーマンスよりも低速になる原因の1つだ。

AnandtechによるRyzen 9 9950Xのレビューでは、Zen 5 CPUは前モデルと比較してCCD間レイテンシが著しく高いことが判明した。

これは、Zen 4とZen 5の両CPUが同様のI/Oダイとインフィニティ・ファブリック設計を共有しているにもかかわらず、である。

しかし、BilibiliのGeekerwanによる最近のレポート(via @9950pro)は、AMDが将来のBIOSパッチを通じてこの問題に対処するよう取り組んでいることを示唆している。

CCD間レイテンシとは、Ryzen 9000 CPU内の2つのZen 5 CCD(Core Complex Dies)間でデータや命令がどれだけ速く転送されるかを示す。

このファブリックは、CCDやIODなどの複数のチップレットとの通信に使用されます。Ryzen 9 9950XとRyzen 9 9900Xには2つのCCDが搭載されており、各CCDには8つのZen 5コアが搭載されているため、8つ以上のコアを使用するプログラムでは、より高速に実行するためにCCD間でデータを転送する必要がある。

残念なことに、先代のRyzen 9 7950Xとは異なり、AMD Ryzen 9 9950XはCCD間のレイテンシが2倍近くある。

Zen 5の平均CCD間レイテンシは180nsであるのに対し、7950Xは76nsである。

この結果、CCD間のデータ転送が遅くなり、一部のワークロードではマルチスレッド性能が予想以上に低下する。

高いCCD間レイテンシは、ダイ設計によるものではなく、AMDのBIOSとチップセット・ソフトウェア・スタック内の未完成で洗練されていない最適化によるものである。

この新しいレポートが示唆するように、AMDは今後数カ月以内に実施されるBIOSアップデートによって、高いCCD間レイテンシを修正する予定だ。

うまくいけば、新しいアップデートでパフォーマンスが向上するだろうが、BIOSアップデートの正確な日付はまだわかっていない。

しかし、ほとんどのゲームでは8つのコアを含む1つ以上のCCDを使用しないため、この修正は必ずしもゲームパフォーマンスに影響しない。

8コア以上を利用できるプログラムでは、CCD間レイテンシの修正によってパフォーマンスの問題を解決できる可能性がある。

ちょうど昨日、AMDはWindows 11 23H2にバックポートを通じて分岐予測の最適化をもたらすと発表したばかりで、Windows 11 24H2で見られたように、ある程度の性能向上が期待できる。

つまり、AMDはおそらく未完成のRyzen 9000シリーズの発売を急いだのだろう。

ソース:wccftech – AMD To Provide Patch That Improves Ryzen 9000 “Zen 5” Inter-Core & Chiplet Latency

 

 

 

 

解説:

Zen5のCCDレイテンシは180ns、Zen4は76ns

だそうです。

この差はBIOSが洗練されてないことによって発生しており、今後改善されていく可能性が高いようです。

初物にはつきものなのかもしれませんが、X3Dまで待った方がやっぱりいいようですね。

もちろんですが、この問題は1CCDのモデルでは発生しませんし、CCD間通信が発生しない多くのゲームでは発生しないようです。

私はマルチコア性能が高い方が性能が良くなるゲームはアサクリのオデッセイくらいしか記憶にありません。

他にもあるのかもしれませんが、大体のゲームは12コア24スレッド、16コア32スレッドを使い切るようにゲームはないんじゃないでしょうか。

いずれにしてもまたしても待つほうが良い理由が出てきてしまいましたねえ。

なかなかに悩ましい問題です。

 

 

 

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